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msp430F123利用端口输出系统时钟

来源:互联网 2023-02-20 18:27:04 446

msp430F123使用中,有时需要输出系统时钟观察时钟频率是否正确。可利用芯片指定的第二功能输出SMCLK等时钟信号。VBL办公区 - 实用经验教程分享!

工具/原料

  • msp430F123芯片
  • 本例外部时钟晶振是4M,IAR编辑环境
  • USB写入器:msp-fet430uif仿真器

方法/步骤

  • 1

    msp430F123芯片存在多种系统时钟和管脚复用。利用这个特定可实现较多功能。P1.4脚是GPIO/TCK/SMCLK复用的。VBL办公区 - 实用经验教程分享!

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  • 2

    从管脚定义它可以做GPIO也可以JTAG还能输出SMCK时钟,这里通过设置P1.4的SMCLK实现时钟频率输出。VBL办公区 - 实用经验教程分享!

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  • 3

    新建一个工程,VBL办公区 - 实用经验教程分享!

    定义端口名字VBL办公区 - 实用经验教程分享!

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  • 4

    P1DIR =P1_RX_UART ; 设置为输出VBL办公区 - 实用经验教程分享!

    P1SEL =P1_RX_UART ; 利用P1SEL选通P1.4的第二功能VBL办公区 - 实用经验教程分享!

    从P1.4输出VBL办公区 - 实用经验教程分享!

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  • 4
  • 5

    初始化设置系统时钟VBL办公区 - 实用经验教程分享!

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    void ClockInit(void)VBL办公区 - 实用经验教程分享!

    { unsigned char i;VBL办公区 - 实用经验教程分享!

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    BCSCTL1 = XTS DIVA_0;VBL办公区 - 实用经验教程分享!

    //#define XTS (0x40) /* LFXTCLK 0:Low Freq. / 1: High Freq. */VBL办公区 - 实用经验教程分享!

    //#define DIVA_0 (0x00) /* ACLK Divider 0: /1 */VBL办公区 - 实用经验教程分享!

    doVBL办公区 - 实用经验教程分享!

    {VBL办公区 - 实用经验教程分享!

    IFG1 &= ~OFIFG; // Clear OSCFault flagVBL办公区 - 实用经验教程分享!

    for (i = 0xFF; i > 0; i--); // Time for flag to setVBL办公区 - 实用经验教程分享!

    }VBL办公区 - 实用经验教程分享!

    while ((IFG1 & OFIFG)); // OSCFault flag still set? VBL办公区 - 实用经验教程分享!

    BCSCTL2 = SELM_3 SELS;// MCLK= LFXT1 (safe)VBL办公区 - 实用经验教程分享!

    //#define SELM_3 (0xC0) /* MCLK Source Select 3: LFXTCLK */VBL办公区 - 实用经验教程分享!

    //#define SELS (0x08) /* SMCLK Source Select 0:DCOCLK / 1:XT2CLK/LFXTCLK */VBL办公区 - 实用经验教程分享!

    for(i=0Xff;i>0;i--)VBL办公区 - 实用经验教程分享!

    _NOP();VBL办公区 - 实用经验教程分享!

    } VBL办公区 - 实用经验教程分享!

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  • 6

    对工程设置以下几个地方VBL办公区 - 实用经验教程分享!

    1) FETDebugger -->setup-->connection选择 USB连接方式VBL办公区 - 实用经验教程分享!

    2)Debugger下的-->setuo-->Driver 选 FET DebuggerVBL办公区 - 实用经验教程分享!

    3) General Options -->Target --> Device -->点按钮选 MSP430F123VBL办公区 - 实用经验教程分享!

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  • 7

    运行,然后用示波器测量 P1.4端口,观察波形。VBL办公区 - 实用经验教程分享!

  • 注意事项

    • USB写入器:msp-fet430uif要设对;
    • P1SEL P1DIR要设对。

    以上方法由办公区教程网编辑摘抄自百度经验可供大家参考!VBL办公区 - 实用经验教程分享!


    标签: 硬件利用输出系统时钟

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